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DDR数字设计工程师（薪资面议）
50-60万
北京、上...
研究生 5-8年 招聘 5 人 预计佣金
84K
02:46发布
72小时新发
JD基本信息
岗位职责
工作职责
1.UCIE PHY & UCIE Logic Layer 数字设计
2.DDRPHY/HBMPHY 数字设计
3.电源管理IP/测温IP/时钟控制IP 数字设计
4.数字信号处理IP（FFT/数字滤波/整流等）数字设计
5.IP专用轻量化定制化处理器IP 数字设计
6.MPW集成设计（类似SoC设计，但本部门不负责量产产品SoC验证）
7.Soc / emulator 集成支持，产品硅后Debug支持
任职要求
工作要求
1. D2D / UCIE 开发经验（包含Physical Layer / Logic layer / Controller相关）
2. PCIe / NVMe 开发经验（包含 PMA / PCS / 各类mode的对应Controller相关）
3. DDRPHY/HBMPHY 开发经验
4. 了解PIPE / RDI / FDI / DFI / DIMM 等协议
5. 自研NIC / NOC / CCI开发经验
所属行业:
通信/网络设备、电子技术、芯片、半导体、集成电路
职能分类:
其他电子/通信/半导体
工作城市:
上海，招聘1人，详细地址：张江工业园区北京，招聘1人，详细地址：北京办公室成都，招聘1人，详细地址：高新区锦弦一路AI创新中心B3苏州，招聘1人，详细地址：苏州工业园区无锡，招聘1人，详细地址：无锡办公室
职位要求
学历要求:
研究生·统招·985/211
工作年限:
5-8年
技能/证书:
-
薪资福利
年薪范围:
50-60万*12薪
薪资福利:
薪资面议
团队架构
所属部门:
-
下属人数:
-
部门架构:
-
汇报对象:
-
职级职称:
-
面试信息
面试轮次:
-
面试流程:
-
视频面试:
不可以接受
