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硬件工程师(原理图)
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25-35万
深圳
大专及以上
3-5年
招聘 10 人
预计佣金
3.1K
1天前发布
72小时新发
HC多
外包
JD基本信息
岗位职责
岗位职责: 1、负责半导体烧录器、测试机等产品的硬件设计与原理图开发; 2、参与嵌入式平台(ARM/FPGA)的电源树设计、时钟分配、接口扩展及信号完整性预分析; 3、完成高速数字电路(DDR/PCIe/Ethernet)、模拟电路(ADC/DAC/传感器前端)、功率电源电路的混合信号设计; 4、制定硬件设计规范,输出BOM、网表及Layout约束规则(叠层/阻抗/等长要求),指导Layout工程师完成PCB实现; 5、配合软件团队完成硬件驱动调试,主导板级功能验证、信号测试及EMC预整改; 6、参与硬件平台化建设,沉淀模块化电路库(Soc模块/通信接口/电源模块)。
任职要求
任职要求: 1、本科及以上学历,电子/自动化/通信等相关专业,3年+原理图设计经验(优秀者可放宽至大专5年+经验); 2、精通数模混合电路设计,能独立完成复杂嵌入式系统的原理图开发与仿真验证; 3、熟悉工业控制器架构:掌握MCU/ARM/FPGA最小系统设计、工业总线(CAN/RS485/EtherCAT); 4、具备信号完整性基础:了解高速信号阻抗控制、时钟树规划、电源完整性(PI)设计要点; 5、熟练使用Altium Designer/Cadence/Mentor等EDA工具; 6、有半导体设备、自动化测试设备、精密运动控制领域经验者优先。
所属行业:
半导体
职能分类:
硬件工程师
工作城市:
深圳,招聘10人,详细地址:深圳市南山区汉京中心7楼
职位要求
学历要求:
大专及以上·统招
工作年限:
3-5年
技能/证书:
-
薪资福利
年薪范围:
25-35万*12薪
薪资福利:
五险一金,节日福利,年度体检等
团队架构
所属部门:
-
下属人数:
-
部门架构:
-
汇报对象:
-
职级职称:
-
面试信息
面试轮次:
2轮
面试流程:
-
视频面试:
可以接受
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职能类别
IT互联网技术
电子/通信/半导体
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